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Qu'est-ce que la maîtrise du bus? - définition de techopedia

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Anonim

Définition - Que signifie la maîtrise du bus?

La maîtrise du bus est une fonctionnalité d'architecture de bus qui permet à un bus de commande de communiquer directement avec d'autres composants sans avoir à passer par le CPU. La plupart des architectures de bus à jour, comme l'interconnexion des composants périphériques (PCI), prennent en charge la maîtrise du bus.


La maîtrise du bus augmente le taux de transfert de données du système d'exploitation, préserve les ressources du système et augmente les performances et le temps de réponse.

Techopedia explique la maîtrise du bus

La maîtrise du bus permet à un bus de contrôle d'accéder à la RAM indépendamment du CPU. Il est conçu pour permettre le transfert de données entre un composant périphérique et la RAM tandis que le CPU met en œuvre d'autres responsabilités.


La plate-forme maître de bus se trouve le plus souvent dans des périphériques d'entrée / sortie (E / S) distincts ou dans un microprocesseur. Il dirige le trafic sur une voie d'E / S ou un bus informatique. Le maître de bus est le «maître» et contrôle les voies de bus qui contiennent les signaux de transmission et l'adresse. Les périphériques d'entrée et de sortie (E / S) sur un bus sont les «esclaves».


Si un ordinateur contient plusieurs composants qui prennent en charge la maîtrise du bus, une structure hiérarchique doit être implémentée pour empêcher plusieurs composants d'essayer d'utiliser le bus en même temps. Il existe plusieurs structures telles que:

  • Interface SCSI (Small Computer System Interface): transfère les données entre l'ordinateur et les périphériques. Comprend une priorité permanente pour chaque ID SCSI
  • Interface périphérique série (SPI): fonctionne en mode duplex intégral (dans les deux sens) en utilisant une architecture maître / esclave. Le dispositif maître lance la trame de données, qui comprend la synchronisation de trame.
  • Interface de circuit inter-intégré (I 2 C): possède une architecture de bus série bidirectionnelle qui contient des messages de bit d'arrêt et de démarrage, qui contrôlent le transfert de données.
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